项目描述 ：
Implementation of FIR filter with time multiplexing and upsampling in Verilog.

高级语言： Mathematica

项目主页：

项目地址: git://github.com/franciszekjuras/firIP.git

创建时间： 2017-11-24T07:34:10Z
项目社区：https://github.com/franciszekjuras/firIP
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